Le processeur est configuré pour prédécoder des octets d'instructions avant leur stockage dans une antémémoire d'instructions.
The processor is configured to predecode instruction bytes prior to their storage within an instruction cache.
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Un nombre fixe d'instructions de longueurs variables est mémorisé dans chaque ligne d'une antémémoire d'instructions.
A fixed number of variable-length instructions are stored in each line of an instruction cache.
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Un processeur est configuré pour prédécoder des octets d'instructions avant leur stockage dans une antémémoire d'instructions.
A processor is configured to predecode instruction bytes prior to storing them in an instruction cache.
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L'invention concerne un appareil et un procédé de gestion de la prélecture d'antémémoire d'instructions dans une antémémoire d'instructions.
Disclosed is an apparatus and method to manage instruction cache prefetching from an instruction cache.
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Une section de récupération d'un processeur comporte une antémémoire d'instructions et un pipeline de plusieurs étages pour l'obtention d'instructions.
A fetch section of a processor comprises an instruction cache and a pipeline of several stages for obtaining instructions.
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Le dispositif comporte une antémémoire d'instructions distincte (30) pour l'exécution normale des instructions.
A separate instruction cache (30) is provided for normal execution of instructions, and all of the instructions written into the branch prediction cache from the system bus must also be stored in the instruction cache.
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Système de traitement de donnée à architecture Harward comportant: un processeur, une mémoire principale, une antémémoire d'instructions et une antémémoire de données.
A Harvard architecture data processing system includes a processor, main memory, an instruction cache, and a data cache.
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Dans un mode de réalisation, ledit microprocesseur comprend une unité de prédécodage (12), une antémémoire d'instructions (16), une antémémoire de données (28) et une antémémoire à deux niveaux (50).
In one embodiment, the microprocessor includes a predecode unit (12), and instruction cache (16), a data cache (28), and a level two cache (50).
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On prend alors les vecteurs dans la table de vecteurs d'instructions, et on les répartit dans une antémémoire d'instructions à ordonnancement préétabli, et en parallèle, dans une unité de production d'instructions.
Instruction vectors are then dispatched from the instruction vector table to a prescheduled instruction cache, and, in parallel, to an instruction issue unit.
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Une antémémoire d'instructions (16) d'un processeur (10) est couplée de façon à recevoir une adresse de lecture en antémémoire (236) et une prévision de cheminement correspondante (280).
An instruction cache (16) in a processor (10) is coupled to receive a fetch address (236) and a corresponding way prediction (280).
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Une unité de prédiction de branchements stocke un ensemble de sélecteurs de branchements correspondant à chaque octet d'un groupe d'octets d'instructions contiguës stockés dans une antémémoire d'instructions.
A brand prediction unit stores a set of branch selectors corresponding to each of a group of contiguous instruction bytes stored in an instruction cache.
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Dans un mode de réalisation, le microprocesseur (10) comprend une unité de prédécodage (12) et une antémémoire d'instructions (16).
In one embodiment, the microprocessor (10) comprises a predecode unit (12) and an instruction cache (16).
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En réponse à la situation de conflit en mémoire, l'instruction correspondant à l'adresse d'instruction est extraite de l'antémémoire d'instructions lorsque cette instruction est stockée dans ladite antémémoire d'instructions.
In response to the memory conflict condition, the instruction corresponding to the instruction address is fetched from the instruction cache when the instruction is stored in the instruction cache.
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Pour ne stocker en antémémoire que les instructions qui provoquent un conflit, l'antémémoire d'instructions peut être de taille réduite.
By selectively caching only those instructions which produce a conflict, a small instruction cache can be used.
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Les pipelines partagent d'autres ressources du processeur, telles qu'une antémémoire d'instructions, un empilement de fichiers de registre, une antémémoire de données, une interface de mémoire et d'autres registres structurés dans le système.
The pipelines share other processor resources, such as an instruction cache, a register file stack, a data cache, a memory interface, and other architected registers within the system.
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