Un premier signal d'échantillonnage de données illustratif est un signal d'échantillonnage de données de lecture fourni par la mémoire.
Le signal d'échantillonnage de données suit, avec un retard prédéterminé, le signal d'échantillonnage d'adresses en colonnes et, de ce fait, tout désalignement de ce dernier est introduit dans le signal d'échantillonnage de données.
Le deuxième circuit logique génère alors une deuxième impulsion d'échantillonnage de données réagissant à l'impulsion globale d'échantillonnage de données suivante.
Dans un autre exemple, le premier signal d'échantillonnage de données est un signal d'échantillonnage de données d'écriture reçu par la mémoire.
L'invention concerne un circuit de synchronisation d'échantillonnage de données comprenant un premier et un deuxième circuit logique recevant des impulsions globales d'échantillonnage de données et un signal d'activation respectif.
Pour effectuer l'échange de signaux de commande, le maître (300) transmet un signal d'échantillon de données d'une durée donnée sur la ligne d'échantillons de données.
Les première et seconde sorties sont configurées pour émettre le signal de transfert d'instruction et le signal de transfert de données, respectivement.
L'impulsion d'activation de données retardée échantillonne la partie retardée du signal de données.
L'invention porte sur des techniques concernant la détermination du moment où un signal stroboscopique de données est valide pour capturer des données.
La première et la deuxième impulsion d'échantillonnage de données sont utilisées pour verrouiller un signal de données dans des bascules bistables respectives.
Le bus de transfert de données (22) comprend une ligne de signal d'échantillon de données (D50, D51) et une ligne de signal de récpetion du transfert de données (DTACK).
La mémoire est constituée de W blocs de mémoire (305) et d'un réseau d'échantillonnage de données (302).
Dans le deuxième mode l'échantillonnage de données n'est pas commandé par le dispositif de mémoire.
Sur la base des résultats de l'échantillonnage, l'impulsion de données et le signal d'horloge local sont synchronisés.
La seconde mémoire tampon de signaux est configurée pour fonctionner en réponse à un second signal d'échantillonnage de données.
Dans un mode de réalisation, un système comprend un contrôleur de mémoire configuré pour recevoir un signal d'échantillonnage de données.
Dans le premier mode l'échantillonnage de données est de source synchrone et est commandé par le dispositif de mémoire lors de la transmission des données.
Cela permet de déverrouiller les données, en réponse au signal d'échantillonnage de données, approximativement au niveau du centre de la fenêtre validée.
Cette mise hors circuit est obtenue au moyen d'un dispositif de temporisation (3) commandé par des impulsions de déclenchement apparaissant au niveau de la connexion (2), qui sert aux impulsions de transfert de données, du circuit de commutation (1).
L'organe (340) de commande de retard peut comporter un circuit (340b) de comptage permettant d'ajuster les signaux d'échantillonnage de données à des intervalles particuliers.
Requêtes fréquentes anglais :1-200, -1k, -2k, -3k, -4k, -5k, -7k, -10k, -20k, -40k, -100k, -200k, -500k, -1000k,
Requêtes fréquentes français :1-200, -1k, -2k, -3k, -4k, -5k, -7k, -10k, -20k, -40k, -100k, -200k, -500k, -1000k,
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